什么是同步与异步时序逻辑电路

什么是同步与异步时序逻辑电路

电平异步时序电路的设计是电路分析的逆过程，即是由逻辑问题的描述，产生实现逻辑功能的电路，其主要设计步骤如下。
　　一、电平异步时序电路的设计步骤概述
　　第一步：根据问题的逻辑要求，建立原始流程表。
　　第二步；将原始流程表简化，得到最简流程表。
　　第三步：对最简流程表进行状态分配及不稳定状态的输出指定。
　　第四步：写出激励状态和输出状态表达式。
　　第五步：画出逻辑电路图。

引用heshiaio的回答：
　　电平异步时序电路的设计是电路分析的逆过程，即是由逻辑问题的描述，产生实现逻辑功能的电路，其主要设计步骤如下。
　　一、电平异步时序电路的设计步骤概述
　　第一步：根据问题的逻辑要求，建立原始流程表。
　　第二步；将原始流程表简化，得到最简流程表。
　　第三步：对最简流程表进行状态分配及不稳定状态的输出指定。
　　第四步：写出激励状态和输出状态表达式。
　　第五步：画出逻辑电路图。
　　同步时序电路只有一个时钟源，也就是所有触发器的时钟端口都是连接到同一个时钟端。
异步时序电路有多个时钟源，每个触发器不是同时被触发的，有时间先后。往往一步时序逻辑电路的后一个触发器的时钟依赖于上一个触发器的输出。
另外，异步时序电路普遍比同步时序电路复杂，并且波形往往会产生毛刺。

1.同步时序电路：同步时序电路是指各触发器的时钟端全部连接在一起,并接系统时钟端;只有当时钟脉冲到来时,电路的状态才能改变;改变后的状态将一直保持到下一个时钟脉冲的到来,此时无论外部输入x有无变化;状态表中的每个状态都是稳定的.
2.异步时序电路：异步时序电路是指电路中除以使用带时钟的触发器外,还可以使用不带时钟的触发器和延迟元件作为存储元件;电路中没有统一的时钟;电路状态的改变由外部输入的变化直接引起.可将异步时序逻辑电路分为脉冲异步时序电路和电平异步时序电路.

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